| 000 |
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01813nam0 2200337 450 |
| 010 |
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■a978-7-121-43907-0■dCNY119.00 |
| 100 |
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■a20220817d2022 em y0chiy50 ea |
| 101 |
1_ |
■achi■ceng |
| 102 |
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■aCN■b110000 |
| 105 |
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■aa a 000yy |
| 106 |
__ |
■ar |
| 200 |
1_ |
■a数字设计■d= Digital design■eVerilog HDL、VHDL和SystemVerilog实现■e+...... |
| 205 |
__ |
■a第4版 |
| 210 |
__ |
■a北京■c电子工业出版社■d2022.07 |
| 215 |
__ |
■a12, 509页■c图■d26cm |
| 225 |
2_ |
■a国外电子与通信教材系列■Aguo wai dian zi yu tong xin jiao cai xi lie |
| 305 |
__ |
■a据原书第6版译出 |
| 306 |
__ |
■a由Pearson Education (培生教育出版集团) 授予出版 |
| 314 |
__ |
■aMano规范汉译姓: 马诺 Ciletti规范汉译姓: 奇莱蒂 |
| 320 |
__ |
■a有书目 |
| 410 |
_0 |
■12001 ■a国外电子与通信教材系列■Aguo wai dian zi yu tong xin jiao cai x+...... |
| 517 |
1_ |
■aVerilog HDL、VHDL和SystemVerilog实现■AVerilog HDL、VHDLhe Syste+...... |
| 606 |
0_ |
■a数字电路■j教材■x电路设计■x高等学校■Ashu zi dian lu |
| 690 |
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■aTN79■v5 |
| 701 |
_1 |
■a马诺■g(Mano, M.Morris)■4著■Ama nuo |
| 701 |
_1 |
■a奇莱蒂■g(Ciletti, Michael D.)■4著■Aqi lai di |
| 702 |
_0 |
■a尹廷辉■4译■Ayin ting hui |
| 702 |
_0 |
■a薛红■4译■Axue hong |
| 702 |
_0 |
■a倪雪■4译■Ani xue |
| 905 |
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■aGSXY■fTN79/M525=6■g1614768 |
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